主要内容

RFSoC模板

RFSoC模板为SoC参考设计提供了一个仿真模型SoC Blockset™支金宝app持包Xilinx®设备．使用此模板模拟完整的参考设计。分析内部和外部连接对发送和接收通信算法的影响，例如内存行为和射频(RF)输入/输出(I/O)行为。

要开始使用SoC Blockset模型来设计启用rfsoc的无线通信系统，请遵循以下步骤使用SoC块集模板创建SoC模型．然后，在FPGA子系统中添加您的发射机和接收机算法，在processor子系统中添加您的处理器算法。

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模板结构

RFSoC模板包括三个模型:Top模型、FPGA模型和Processor模型。在顶级模型中射频数据转换器模块连接到FPGA模块，提供射频I/O接口。FPGA块实现接收机和发射机算法。FPGA算法包括测试源块，它产生一个正弦信号，并通过传输算法子系统将其驱动到数模转换器(DAC)。发送算法子系统采用简单的直通线实现，接收算法子系统采用下采样逻辑实现。配置寄存器SrcSelReg在FPGA中建模，为接收机算法子系统选择数据源。处理器写入SrcSelReg寄存器选择来自FPGA的测试源或来自FPGA中模数转换器(ADC)的RF数据射频数据转换器块。来自FPGA子系统的数据通过a传递给处理器子系统内存通道块。的渠道类型参数中的内存通道Block被设置为AXI4-Stream通过DMA传输到软件，它模拟了通过共享外部内存的直接内存访问(DMA)数据传输。

使用此模板作为指南，用您自己的功能替换FPGA模型中的接收算法和发送算法子系统以及处理器模型中的处理器算法子系统。在此模板中，射频数据转换器块配置了一个自定义射频接口，该接口具有一个DAC (DAC7)和一个ADC (ADC1)和一个I/Q数字接口。每个时钟周期采样个数设置为2。该模板中的RF路径被回环。如果你想为发射器和接收器使用不同的数据，你可以去掉环路，并向ADC提供你想要的输入数据。

处理器从内存中读取计算数据并执行额外的计算(在模板中作为传递线实现)。图标，可查看模拟结果时间范围块Testbench水槽子系统。

修改项目

修改FPGA模型

在MATLAB中®工具条上的项目的快捷方式选项卡上,单击开放式FPGA模型．然后，打开FPGA Tx-Rx Alg Wrapper子系统。如图所示，有三个区域用绿色突出显示。这些区域表示用户代码，位于测试源块,发射机算法子系统，以及接收机算法子系统。

FPGA模型包括这些部分(用绿色突出显示)供您修改。

  • 测试源block -该块生成一个500khz的正弦信号，并将其驱动到发射器算法子系统。根据您的需要修改测试源，或者用替代源块替换它。

  • 发送算法子系统-包含以绿色突出显示的Tx算法子系统。用您自己的发送器算法替换Tx算法子系统。

  • 接收算法子系统-包含绿色突出显示的Rx算法子系统。用您自己的接收机算法替换Rx算法子系统。

  • IP核寄存器读取块-在测试设计(DUT)中，添加这些块将寄存器添加到算法IP中。初始化此块使用对应的寄存器写块在处理器模型。

要启用一致的模拟行为，请在项目的快捷方式选项卡上,单击开放式FPGA模型重复这一步。

修改处理器模型

在MATLAB工具条中，在项目的快捷方式选项卡上,单击开放处理器模型．处理器模型包含处理器算法包装器和初始化函数子系统。处理器算法包装器子系统用蓝色突出显示，它表示处理器算法的用户代码。打开处理器算法包装器子系统，用所需的算法替换内部处理器算法子系统(也用蓝色突出显示)。打开初始化函数子系统并添加一个寄存器写每个方块IP核寄存器读取块中添加的FPGA模型。

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