硬件实现面板
硬件实现面板概述
硬件板设置
参数 | 描述 | 默认值 |
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处理单元 | 处理器模型参考块的SoC模型。 | 没有一个 |
设计的映射
参数 | 描述 | 默认值 |
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设计的映射 | 开放硬件映射工具。 |
不适用 |
任务分析仿真
任务分析处理器
操作系统/调度器
参数 | 描述 | 默认值 |
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操作系统/调度器 | 指定操作系统的内核延迟的模拟任务。 |
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任务和内存模拟
参数 | 描述 | 默认值 |
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为模拟任务持续时间和内存访问设置种子 | 设置随机数生成器的种子。 | 从 |
种子值 | 指定的种子值模拟任务持续时间偏差。 |
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在任务启动缓存输入数据 | 缓存输入数据的一个任务。 |
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板参数
参数 | 描述 | 默认值 |
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设备地址 | 网络地址的硬件或设备。 | 192.168.1.10 |
用户名 | 登录用户名 硬件板上或设备。 |
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密码 | 硬件板或设备上登录密码。 |
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处理器
参数 | 描述 | 默认值 |
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数量的核 | 设置的CPU核的处理器。 | 1 |
期权
参数 | 描述 | 默认值 |
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建立行动 | 定义了如何SoC建设者当你构建你的模型工具响应。 |
构建、加载和运行 |
孵蛋的
参数 | 描述 | 默认值 |
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CPU时钟(MHz) | MHz的CPU时钟频率。 |
1000年 |
外部模式
参数 | 描述 | 默认值 |
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通信接口 | 传输层之间交换数据所使用的计算机和硬件开发。 |
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外部模式运行在一个后台线程 | 执行外部模式引擎生成的代码在一个后台任务。 |
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港口 | IP地址端口硬件板上。 |
17725年 |
详细的 | 启用的外部视图模式执行诊断查看器中进步和更新。 |
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FPGA设计(顶级)
参数 | 描述 | 默认值 |
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查看/编辑内存映射 | 选择是否执行全球合成或每IP核合成。 |
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包括MATLAB AXI大师的IP为基于主机的交互 | 使用基于主机的脚本和一个集成的JTAG主在目标平台上。 |
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包括处理系统 | 对于处理器的平台,包括处理系统。 |
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中断延迟(s) | 延迟从硬件维护一个中断的中断服务例程的开始。 |
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寄存器配置时钟频率(MHz) | 系统配置时钟驱动器的配置接口注册供应商系统中IP核。 |
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IP核心的时钟频率(MHz) | 时钟仿真软件金宝app®基于生成的HDL IP核。 |
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FPGA设计(PS mem控制器)
这些参数的默认值随板。
参数 | 描述 | 默认值 |
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控制器时钟频率(MHz) | datapath公司的频率PS内存之间的互连和PS内存控制器。 |
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控制器的数据宽度(比特) | 位的宽度datapath公司PS内存之间的互连和PS内存控制器。 |
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带宽降低税率(%) | 每100个时钟,将所有事务执行的这个数字时钟。 |
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第一个写传输延迟(时钟) | 之间的时钟周期数写请求和转移的开始。 |
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最后写传输延迟(时钟) | 数量之间的时钟周期结束写转让和完成交易。 |
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第一次读到传输延迟(时钟) | 读取之间的时钟周期数请求和转移的开始。 |
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去年读传输延迟(时钟) | 读取结束之间的时钟周期数转移和完成交易。 |
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FPGA设计(PL mem控制器)
这些参数的默认值随板。
参数 | 描述 | 默认值 |
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控制器时钟频率(MHz) | 频率之间的datapath公司PL内存互连和PL内存控制器。 |
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控制器的数据宽度(比特) | 位宽度之间的datapath公司PL内存互连和PL内存控制器。 |
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带宽降低税率(%) | 每100个时钟,将所有事务执行的这个数字时钟。 |
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第一个写传输延迟(时钟) | 之间的时钟周期数写请求和转移的开始。 |
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最后写传输延迟(时钟) | 数量之间的时钟周期结束写转让和完成交易。 |
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第一次读到传输延迟(时钟) | 读取之间的时钟周期数请求和转移的开始。 |
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去年读传输延迟(时钟) | 读取结束之间的时钟周期数转移和完成交易。 |
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FPGA设计(mem频道)
参数 | 描述 | 默认值 |
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互连的时钟频率(MHz) | 频率的主控制器互连的datapath公司MHz。 |
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互连的数据宽度(比特) | 数据宽度主datapath公司在比特互连控制器。 |
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互连FIFO的深度(num破裂) | 最大数量的爆发之前,可以缓冲数据被删除。 |
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互连几乎最大深度 | 几乎完全达到深度时,连接通道协议接口块断言背压到数据源。 |
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