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Xilinx Zyn金宝appq平台的HDL编码器支持包

运动 MathWorks HDL编码器团队
为Zynq-7000 SoC的FPGA部分生成代码。
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Actualizado9月14日

Xilinx®Zynq金宝app®-7000平台的HDL Coder™支持包支持IP核的生成，可以使用Xilinx Vivado®或Xilinx ISE集成到FPGA设计中。当与Xilinx Zynq-7000平台的嵌入式Coder®支持包结合使用时，该解决方案可以金宝app使用C和HDL代码生成对Xilinx Zynq SoC进行编程。硬件/软件协同设计工作流涵盖模拟、原型、验证和实现。

此支持包适金宝app用于R2013a及以上版本。

兼容性con la versión de MATLAB
Se creó con R2014a
兼容con cualquier versión desde R2014a hasta R2022b
兼容平台
窗户 macOS Linux

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