2019冠状病毒-奥斯布鲁赫(COVID-19)更新

Aufgrund erhöhter Besorgnis über den Ausbruch von COVID-19 bieten wir weitere, von Ausbildern geleitete Online-Kurse als Alternative zu regulärem Unterricht an。

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Voraussetzungen

金宝appSimulink zur System- und AlgorithmenmodellierungOder äquivalent sind dringend empfohlen。肯尼尼斯C和HDL程序设计语言的旋涡。

程序员冯Xilinx Zynq soc mit MATLAB和Simulink金宝app

在实际应用中，zweitägigen将实现您的模型，并在Simulink中运行金宝app^®-还有Xilinx^®Zynq^®-7000所有可编程soc。训练richtet是一个Simulink-Nutzer，模金宝app具嵌入式代码，所以是HDL代码erzegen， überprüfen和实现者。软件/硬件协同设计，我们采用Hilfe von嵌入式编码器^®和高密度脂蛋白编码器^™嗯。

我们可以使用ZedBoard^™zur Verfügung gestellt, welches während der Schulung programmieren。嗯，我的名字是Beispiele， Übungen auh anschießend noch bebeiten zu können, dürfen您的注册板selbstverständlich behalten。

他们在安德里姆下发现:

Überblick über die Zynq platform and Einrichten der Entwicklungswerkzeuge
Einführung zum嵌入式编码器和HDL编码器
erzegen和Verwenden都拥有IP核
Verwenden der ax4 Schnittstelle
Processor-in-the-Loop Verifikation
Datenschnittstelle贝Echtzeitanwendungen
Entwickeln冯Geratetreibern
Benutzerdefiniertes Referenz设计

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Voraussetzungen

金宝appSimulink zur System- und AlgorithmenmodellierungOder äquivalent sind dringend empfohlen。肯尼尼斯C和HDL程序设计语言的旋涡。

Tag 1 von 2
Überblick über die Zynq platform and Einrichten der Entwicklungswerkzeuge	目标:Einrichten的Zynq-7000平台和MATLAB Umgebung。 Ubersicht祖茂堂zynq - 7000 Einrichten的Zynq平台和软件 MATLAB Umgebung的Konfigurieren Testen der verindung zur Zynq Hardware
Einführung zum嵌入式编码器和HDL编码器	目标:Simulink-Modellen，金宝app嵌入式和HDL代码的通用和解释。这是一个很好的应用 Codegenerierung für Echtzeitsysteme (Embedded -R宝莲寺-T输入法) Codemodule 这是通用代码 Konfigurieren eines模型für模具HDL代码erzeugong Einsetzen des HDL工作流顾问
erzegen和Verwenden都拥有IP核	目标:Mit Hilfe des HDL工作流顾问在Simulink modelell金宝app konfigurien, HDL和C Code ereugen和Zynq平台实现者。 Konfigurieren eines子系统für可编程逻辑(PL) 爱因斯坦的世界和周边 erzegen设计了IP核和增强集成 fpga -比特流的Erstellen和实现者软件接口模型的Erstellen和实现者爱因斯坦参数während einer外模态仿真
在AXI4 Schnittstelle上	目标:AXI公司的数据处理系统和可编程逻辑系统。 Überblick zur AXI Schnittstelle AXI4-Lite Anwendungen Benutzen冯AXI4-Stream Überlegungen bezüglich AXI4 Leistung
Processor-in-the-Loop Verifikation	目标:环路中的处理器，嗯Zynq平台的算法während deren Laufzeit可以验证和使用Laufzeiten。 Arbeiten mit processor -in- loop (PIL)基于Zynq平台太平船务验证太平船模 Laufzeitmessung麻省理工学院公益诉讼 Uberlegungen祖茂堂公益诉讼

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Datenschnittstelle贝Echtzeitanwendungen	目标:Gewährleisten des Datenaustauschs zwischen 金宝appSimulink和Echtzeitanwendung与Zynq平台的HilfeUser -Datagram -Protocol Schnittstelle。 Überblick über die Datenschnittstelle UDP Konfigurieren des UDP-Blocks für Datenaustausch 与Zynq同步金宝app Benutzen von AXI4-Stream Datenschnittstelle Designunterteilung Uberlegungen苏珥Datenschnittstelle
Entwickeln冯Geratetreibern	目标:Entwickeln von Gerätetreibern zur integrated von Peripherie auf dem Zynq Processing System。 Ablauf bei der Entwicklung von Gerätetreibern 遗留代码工具 Verknüpfen zur GPIO Schnittstelle 交叉编译冯Geratetreiberkomponenten
Benutzerdefiniertes Referenz设计	目标:erzegen wiederverwendbarer IP-Cores für Vivado and Registrieren eines benutzerdefinerten Referenz Designs。 Gründe für ein benutzerdefinertes参考设计 erzegen wiederverwendbarer IP-Cores für Vivado Referenz设计Uberblick anpasen eines参考设计注册板和参考设计

时间garantiert。

在这里输入样例:für这是我第一次来这里，在这里我要做的是找到一个合适的时间，然后再去找一个合适的时间。

MATLAB和Simu金宝applink kursprogram

Durchführung死于疾病。