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addAXI4SlaveInterface

写入数据到IP核心或读取数据从IP核心使用AXI4或AXI4-Lite接口

自从R2020b

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语法

addAXI4SlaveInterface (hFPGA)
addAXI4SlaveInterface (hFPGA、名称、值)

描述

例子

addAXI4SlaveInterface (hFPGA)增加了一个AXI4奴隶界面,您可以使用它们来控制DUT的端口映射到AXI4或AXI4-Lite接口的HDL编码器™从MATLAB生成的IP核®。

例子

addAXI4SlaveInterface (hFPGA,名称,值)增加了一个AXI4奴隶界面,您可以使用它们来控制DUT的端口映射到AXI4或AXI4-Lite接口的HDL编码器从MATLAB生成的IP核,与一个或多个属性指定为参数名称-值对。附上每个属性和值在单引号。

例子

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添加一个AXI4奴隶Xilinx的接口®目标。

创建一个目标对象,hFPGA目标设备。

hFPGA = fpga (“Xilinx”)
hFPGA = fpga与属性:供应商:“Xilinx”界面:[0 x0 fpgaio.interface.InterfaceBase]

添加AXI4奴隶接口hFPGA通过使用对象addAXI4SlaveInterface函数。

% % AXI4-LiteaddAXI4SlaveInterface (hFPGA……%的界面属性“InterfaceID”,“AXI4-Lite”,…“BaseAddress”,0 xa0000000,…“AddressRange”0 x10000,……%驱动程序属性“WriteDeviceName”,“mwipcore0: mmwr0”,…“ReadDeviceName”,“mwipcore0: mmrd0”);

后添加的接口,使用mapPort接口函数映射端口,然后读取和写入数据。看到地图DUT港口HDL IP核心AXI4奴隶接口。

添加一个英特尔AXI4奴隶接口®目标。

创建一个目标对象,hFPGA,英特尔的目标。

hFPGA = fpga (“英特尔”)
hFPGA = fpga与属性:供应商:“英特尔”界面:[0 x0 fpgaio.interface.InterfaceBase]

添加AXI4奴隶接口hFPGA通过使用对象addAXI4SlaveInterface函数。

% % AXI4addAXI4SlaveInterface (hFPGA……%的界面属性“InterfaceID”,“AXI4”,…“BaseAddress”,0 xa0000000,…“AddressRange”0 x10000,……%驱动程序属性“WriteDeviceName”,“mwipcore0: mmwr0”,…“ReadDeviceName”,“mwipcore0: mmrd0”);

后添加的接口,使用mapPort接口函数映射端口,然后读取和写入数据。看到地图DUT港口HDL IP核心AXI4奴隶接口。

添加一个AXI4奴隶接口为一个独立的Xilinx的目标。

创建一个目标对象,hFPGA目标设备。

hFPGA = fpga (“Xilinx”)
hFPGA = fpga与属性:供应商:“Xilinx”界面:[0 x0 fpgaio.interface.InterfaceBase]

作为独立的FPGA板没有嵌入式ARM®处理器,您可以使用AXI经理司机。使用aximanager对象指定AXI经理驱动程序,然后将这些信息添加到addAXI4SlaveInterface函数。

%创建一个“aximanager”对象hAXIMDriver = aximanager (“Xilinx”);%通过addInterface命令addAXI4SlaveInterface (hFPGA……%的界面属性“InterfaceID”,“AXI4-Lite”,…“BaseAddress”,0 xb0000000,…“AddressRange”0 x10000,……%驱动程序属性“WriteDriver”hAXIMDriver,…“ReadDriver”hAXIMDriver,…“DriverAddressMode”,“全部”);

后添加的接口,使用mapPort接口函数映射端口,然后读取和写入数据。看到地图DUT港口HDL IP核心AXI4奴隶接口。

输入参数

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fpga对象为目标供应商,指定为一个fpga对象。

名称-值参数

指定可选的双参数作为Name1 = Value1,…,以=家,在那里的名字参数名称和吗价值相应的价值。名称-值参数必须出现在其他参数,但对的顺序无关紧要。

R2021a之前,用逗号来分隔每一个名称和值,并附上的名字在报价。

例子:addAXI4SlaveInterface (hFPGA“InterfaceID”、“AXI4-Lite”)创建一个AXI4奴隶接口InterfaceID作为AXI4-Lite。

AXI4-Lite或AXI4接口的名称,你想DUT的端口映射到指定为一个字符串。

基地址AXI4或AXI4-Lite奴隶接口,指定为一个数值。

例子:0 x40010000

地址范围AXI4或AXI4-Lite接口,指定为一个数值。

例子:0 x10000

IIO设备的名称和路径,你想写。当你生成IP核心使用IP核心代工作流,默认名称mwipcore0: mmwr0。

例子:“mwipcore0: mmwr0”

IIO设备的名称和路径,你要读的书。当你生成IP核心使用IP核心代工作流,默认名称mwipcore0: mmrd0。

例子:“mwipcore0: mmrd0”

AXI司机使用的名字写入数据。您可以指定这个属性的匹配HDL™aximanager对象为独立的FPGA板。对于SoC平台,高密度脂蛋白编码器自动创建驱动程序。

例子:“aximanager (Xilinx)”

AXI司机的名字用来读取数据。你可以指定这个属性作为高密度脂蛋白校验aximanager对象独立FPGA板没有嵌入式ARM处理器。对于SoC平台,高密度脂蛋白编码器自动创建驱动程序。

例子:“aximanager (Xilinx)”

指定是否AXI司机预计一个完整的地址,包括基址和偏移地址,还是希望只有一个偏移地址。

例子:“抵消”

版本历史

介绍了R2020b

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功能

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