要开始,请参阅建立MATLAB-HDL模拟器连接或在Simulink中启动用于协同仿真的HDL模拟器金宝app.
MATLAB®和仿真软金宝app件®金宝app支持节奏®使用HDL验证器的验证工具™. 仅64位版本的Incisive®支持协金宝app同模拟。请使用以下推荐版本之一,这些版本已针对当前版本进行了全面测试:
Xcelium™19.03
HDL验证程序共享库(liblfihdls *所以
,liblfihdlc *所以
)使用海湾合作委员会
包含在节奏中的精辟®模拟器平台分布。在您将自己的应用程序链接到HDL模拟器之前,请首先尝试针对此进行构建海湾合作委员会
. 有关如何构建和链接自己的应用程序的更多详细信息,请参阅HDL模拟器文档。
MATLAB和Simu金宝applink金宝app支持Mentor图形®验证工具使用HDL验证器。使用以下推荐版本之一。每个版本都经过了针对当前版本的全面测试:
奎斯塔®Core/Prime 2020.4
ModelSim®2020.4体育
请注意
HDL验证器不支持ModelSim的这些版本金宝app:
ModelSim我
英特尔模型®FPGA版本
ModelSim-Intel Starter版本
QuestaSim英特尔FPGA版
QuestaSim英特尔入门版
MATLAB和Simu金宝applink金宝app支持Xilinx®设计工具使用HDL验证器。使用以下推荐版本的fpga -in- loop (FIL)工具:
Xilinx Vivado®2020.1
Xilinx ISE 14.7
请注意
斯巴达的FPGA板需要Xilinx ISE®6, Virtex®-4、Virtex-5和Virtex-6家族。
有关工具设置的说明,请参见建立FPGA设计软件工具.
MATLAB和Simu金宝applink金宝app支持Intel设计工具使用HDL验证器。使用推荐版本的FIL工具:
英特尔四分之一®Prime 18.1
英特尔Quartus Prime Pro 20.2(英特尔C金宝appyclone支持®(仅限10 GX)
Intel Quartus II 13.1(仅金宝app支持Intel Cyclone III板)
有关工具设置的说明,请参见建立FPGA设计软件工具.
MATLAB和Simu金宝applink金宝app支持Microsemi®使用HDL验证器设计工具。将FIL工具与以下推荐版本一起使用:
Microsemi自由人®SoC v12.0
有关工具设置的说明,请参见建立FPGA设计软件工具.
关于板的支持,请参阅金宝app金宝app支持的FPGA设备用于FPGA验证.
附加板可以使用自定义添加FPGA板经理.看到金宝app支持FPGA器件族单板定制.
JTAG连接
供应商 | 所需的硬件 | 所需软件 |
---|---|---|
英特尔 | USB Blaster I或USB Blaster II下载电缆 |
|
锡林克斯 | Digilent®下载电缆。
|
|
FTDI USB-JTAG电缆
|
安装这些D2XX驱动程序。
安装指南请参见D2XX司机从FTDI芯片网站。 |
|
Microsemi | 不支持JTAG连接金宝app |
请注意
当使用Simulink或MATLAB通过Digilent JTAG电缆模拟FPGA设计时,您不能使用任何需要访问JTAG的调试软件;金宝app例如,Vivado逻辑分析仪。
以太网连接
所需的硬件 | 金宝app支持的接口[一个] | 所需软件 |
---|---|---|
|
|
对以太网连接没有软件要求,但要确保主机上的防火墙不阻止UDP通信。 |
[一个]的Microsemi FPG金宝appA板的HDL验证器支持包金宝app仅支持SGMII接口。 |
请注意
低于2019.2金宝app的Vivado版本支持RMII。
低于2013.4的Vivado版本不支持到Virtex-7 VC707的以太网连接。金宝app
HDL Verifier支金宝app持FIL仿真、FPGA数据捕获和MATLAB AXI master设备,如下表所示。这些板的板定义文件在下载FPGA单板支持包金宝app.通过FPGA板定制,您可以添加其他与FIL、FPGA数据捕获和MATLAB AXI master一起使用的FPGA板(FPGA板定制).
设备的家庭 | 董事会 | 以太网 | JTAG | PCI Express | 评论 | ||||||
---|---|---|---|---|---|---|---|---|---|---|---|
费尔 | FPGA数据捕获 | MATLAB AXI主 | 费尔 | FPGA数据捕获 | MATLAB AXI主 | 费尔[一个] | FPGA数据捕获 | MATLAB AXI主 | |||
Xilinx Artix®-7 |
数字Nexys™ 4 Artix-7 |
x | x | x | x | ||||||
Digilent艺术委员会 | x | x | x | x | x | x | |||||
Xilinx Kintex®-7 |
Kintex-7 KC705 | x | x | x | x | x | x | x | |||
Xilinx Kintex UltraScale™ |
kindex UltraScale FPGA KCU105评估试剂盒 |
x | x | x | x | x | x | ||||
Xilinx Kintex UltraScale +™ |
Kintex UltraScale+FPGA KCU116评估套件 |
x | x | x | x | x | x | 有关详细信息,请参阅PCI Express MATLAB AXI Master(Xilinx FPGA板的金宝appHDL验证器支持包). | |||
Xilinx Spartan-6 |
Spartan-6 SP605 | x | x | x | |||||||
Spartan-6 SP601 | x | x | x | ||||||||
XUP Atlys Spartan-6 | x | x | x | ||||||||
Xilinx Spartan-7 |
Digilent艺术S7-25 | x | x | x | |||||||
Xilinx Virtex UltraScale |
Virtex UltraScale FPGA VCU108评估试剂盒 |
x | x | x | x | x | x | ||||
Xilinx Virtex UltraScale + |
Virtex UltraScale+ FPGA VCU118评估套件 |
x | x | x | x | x | x | ||||
Xilinx Virtex-7 |
Virtex-7 VC707 | x | x | x | x | x | x | x | |||
Virtex-7 VC709 | x | x | x | x | |||||||
Xilinx Virtex-6 |
Virtex-6 ML605 | x | x | x | |||||||
Xilinx Virtex-5 |
Virtex ML505 | x | x | x | |||||||
Virtex ML506 | x | x | x | ||||||||
Virtex ML507 | x | x | x | ||||||||
Virtex XUPV5-LX110T | x | x | x | ||||||||
Xilinx Virtex-4 |
Virtex ML401 | x | x | x |
请注意 金宝app对Virtex-4设备家族的支持将在未来的版本中被移除。 |
||||||
Virtex ML402 | x | x | x | ||||||||
Virtex ML403 | x | x | x | ||||||||
Xilinx Zynq® |
zynq - 7000 ZC702 |
x | x | x | |||||||
zynq - 7000 ZC706 | x | x | x | x | |||||||
刨花板™ | x | x | x | x | 使用标有“PROG”的USB端口进行编程。 | ||||||
ZYBO™Zynq-7000开发委员会 |
x | x | x | ||||||||
皮科塞德™ SDR开发工具包 | x | x | x | ||||||||
MiniZed™ | x | x | |||||||||
Xilinx Zynq UltraScale + |
Zynq UltraScale+ MPSoC ZCU102评估试剂盒 |
x | x | x | |||||||
Zynq UltraScale+ MPSoC ZCU104评估试剂盒 |
x | x | x | ||||||||
Zynq UltraScale+MPSoC ZCU106评估套件 |
x | x | x | ||||||||
Zynq UltraScale+ RFSoC ZCU111评估试剂盒 |
x | x | x | ||||||||
Zynq UltraScale+ RFSoC ZCU216评估试剂盒 |
x | x | x | ||||||||
英特尔Arria®2 |
Arria II GX FPGA开发工具包 | x | x | x | x | ||||||
英特尔Arria V |
Arria V SoC开发工具包 | x | x | x | |||||||
Arria V初学者工具包 | x | x | x | x | |||||||
英特尔Arria 10 |
Arria 10 SoC开发工具包 | x | x | x | x | 对于以太网连接,请使用Quartus Prime 16.1或更新版本。 |
|||||
Arria 10 GX | x | x | x | x | x | x | 对于以太网连接,请使用Quartus Prime 16.1或更新版本。 Quartus Prime 18.0不推荐用于Arria 10 GX而不是PCI Express®. |
||||
英特尔旋风四世 |
Cyclone IV GX FPGA开发工具包 | x | x | x | x | ||||||
DE2-115发展和教育委员会 | x | x | x | x | 阿尔特拉的®DE2-115 FPGA开发板有2个以太网端口。FIL仅使用Ethernet 0端口。请确保您的主机通过以太网电缆与板上的Ethernet 0端口连接。 | ||||||
BeMicro SDK | x | x | x | x | |||||||
英特尔第三旋风 |
Cyclone III FPGA入门套件 | x | x | x | Altera旋风III板支持Quartus II 13.1金宝app 请注意 金宝app在未来的版本中,将取消对Cyclone III设备家族的支持。 |
||||||
Cyclone III FPGA开发工具包 | x | x | x | x | |||||||
Altera Nios II嵌入式评估套件,气旋III版 | x | x | x | x | |||||||
英特尔气旋V |
Cyclone V GX FPGA开发工具包 | x | x | x | x | ||||||
Cyclone V SoC开发工具包 | x | x | x | ||||||||
旋风V燃气轮机开发工具包 | x | x | x | x | x | ||||||
Terasic Atlas SoC套件/DE0纳米SoC套件 | x | x | x | ||||||||
箭头®SoCKit开发工具包 | x | x | x | ||||||||
Intel Cyclone 10 LP |
Altera旋风10低压评估试剂盒 |
x | x | x | |||||||
英特尔旋风10 GX |
Altera Cyclone 10 GX FPGA评估工具包 |
x | x | x | 必须使用Quartus Prime Pro。 |
||||||
英特尔马克斯®10 |
Arrow MAX 10 DECA |
x | x | x | x | x | |||||
英特尔Stratix®4 |
Stratix IV GX FPGA开发工具包 | x | x | x | x | ||||||
英特尔Stratix V |
DSP开发工具包,Stratix V版 |
x | x | x | x | x | |||||
Microsemi SmartFusion®2 |
Microsemi SmartFusion2 SoC FPGA高级开发工具包 |
x | 看到安装Microsemi SmartFusion2 SoC FPGA Advanced Development Kit(Microsemi FPG金宝appA板的HDL验证器支持包). | ||||||||
Microsemi Polarfire® |
Microsemi Polarfire评估试剂盒 |
x | 看到安装Microsemi Polarfire评估试剂盒(Microsemi FPG金宝appA板的HDL验证器支持包). | ||||||||
Microsemi RTG4® |
RTG4-DEV-KIT |
x | |||||||||
[一个]仅支持64位Windows操作系统使用PCI Express连接。金宝app |
限制
对于具有多个FPGA设备的FPGA开发板,只有一个这样的设备可以与FIL一起使用。
FPGA板支持包。金宝appFPGA板支持包包含所有支持板金宝app的定义文件。您可以下载一个或多个特定于供应商的软件包。要使用FIL,请至少下载其中一个软件包,或自定义您自己的板定义文件。看见创建自定义FPGA板定义.
要查看HDL验证程序支持包的列表,请访问金宝appHDL验证器支持的硬件金宝app.下载FPGA板支持包:金宝app
在MATLAB首页选项卡,环境部分中,点击附加组件>获取硬件支持包金宝app.
HDL验证器支持以下FPG金宝appA设备家族的板定制;也就是说,当您创建自己的板定义文件时。看到FPGA板定制.PCI Express不是板自定义支持的连接金宝app。
请注意
的Microsemi FPG金宝appA板的HDL验证器支持包不支持单板定制。金宝app
设备的家庭 | 限制 | |
---|---|---|
锡林克斯 | Artix 7 | |
Kintex 7 | ||
Kintex UltraScale |
||
Kintex UltraScale + |
||
斯巴达人6 | 不支持以太网PHY RGMII。金宝app |
|
斯巴达式的7 | ||
Virtex - 4 |
请注意 金宝app对Virtex-4设备家族的支持将在未来的版本中被移除。 |
|
Virtex 5 | ||
Virtex 6 | ||
Virtex 7 | 金宝app仅支持以太网PHY SGMII。 |
|
Virtex UltraScale |
||
Virtex UltraScale + |
||
Zynq 7000 | ||
Zynq UltraScale + |
||
英特尔 | Arria二世 | |
阿里亚五世 | ||
Arria 10 | ||
旋风III |
请注意 金宝app在未来的版本中,将取消对Cyclone III设备家族的支持。 |
|
旋风四世 | ||
气旋V | ||
旋风分离器10 LP | ||
飓风十GX | ||
马克斯10 | ||
Stratix IV | ||
Stratix V |
UVM和DPI组件生成支持与协同仿真相同的Cadence Inci金宝appsive和Mentor Graphics Questa和ModelSim版本。您可以生成用于64位或32位Incisive的DPI组件。
此外,UVM和DPI组件生成还支持:金宝app
Synopsys对此®风投®MX o - 2018.09 SP2
请注意
在Debian上运行ModelSim 10.5b中的DPI组件时®8.3,你可能会遇到一个库不兼容错误:
**警告:**警告:(vsim-7032) 64位glibc RPM似乎没有安装在此机器上。对gcc的调用可能失败。** Fatal: ** Error:(vsim-3827) Could not compile ' stub_syms_of_fooourso ':
设定构建配置到快速跑
.
或者,设置构建配置到具体说明
并指定编译器标志-臭氧
.
UVM生成还需要一个UVM参考实现,可从UVM标准的网站.对于每个受支持的模拟器,此特性都使用默认的发布版本进行测试。金宝app
在当前版本中,TLMG包括对以下各项的支持:金宝app
编译器:
Visual Studio®: VS2008、VS2010、VS2012、VS2013、VS2015和VS2017
Windows 7.1 SDK
gcc 6.3
系统C:
SystemC 2.3.1(包含TLM)
您可以在以下位置下载SystemC和TLM库:https://accellera.org.有关如何在下载后构建这些库的信息,请参阅Accellera Systems Initiative网站。
系统C建模库(SCML)
SCML 2.4.3
您可以从这里下载SCMLhttps://www.synopsys.com.
当在Windows机器上执行HDL验证器产品示例时,可能会出现由Windows路径限制为260个字符引起的错误。有时,条件可以被捕获,你可能会收到如下错误:
生成失败,因为生成文件名超过了Windows限制的260个字符。从具有较短路径的工作目录进行构建,以允许使用较短的文件名创建构建文件
.
然而,通常情况下,在执行第三方工具(如Vivado或Quartus)的过程中会产生长路径,这些工具产生的错误似乎是无关的。此类错误的一些示例如下:
c:\Users\user\OneDrive - MathWorks\Documents\MATLAB\Examples\R2021b\xilinxfpgaboards\ ZynqEthernet\ ethernettaximasterzynq . \src \ sources_1 \ bd \ design_1 ip \ design_1_mig_7series_0_0 \ _tmp \ \ / design_1_mig_7series_0_0 / example_design / rtl / traffic_gen / mig_7series_v4_2_axi4_tg。v请考虑使用OS subst命令将路径的一部分映射到虚拟驱动器号,以缩短路径长度。看到回答记录AR52787为更多的信息。解决方法:在Windows 7或更高版本中,mklink命令也可以用来创建符号链接并缩短路径。
WARNING: [Vivado 12-8222] Failed run(s): 'clk_wiz_0_synth_1', 'simcycle_fifo_synth_1' wait_on_run: Time (s): cpu = 00:00:00;时间= 00:02:16。内存(MB):峰值= 1636.988;} {# error " error: Synthesis failed"} {# error " error: Synthesis failed"}
Error (12006): Node instance "ident" instantiates undefined entity "alt_sld_fab_altera_connection_identification_hub_171_gdd6b5i"确保所需的库路径被正确指定,定义指定的实体,或更改实例化。如果此实体表示英特尔FPGA或第三方IP,则为该IP生成合成文件。
当运行示例的根文件夹已经相当长(例如超过100个字符)时,可能怀疑路径过长。
在检测到和未检测到的长路径场景中,为避免错误,请使用以下方法之一:
将示例目录映射到较短的驱动器别名。例如,下面将从路径中删除122个字符,为260个字符限制提供更多空间。
cmd>subst W:“C:\Users\janedoe\OneDrive-Personal\Documents\MATLAB\Examples\R2021b\hdlverifer\GettingStartedWithSimul金宝appinkHDLCosimExample”
打开示例后,将示例目录复制到具有简短名称的目录中(例如/tmp
).