硬件支持金宝app

Xilinx FPGA板支持从HDL金宝app验证

使用HDL Verifier for FPGA in-the-loop (FIL)支持X金宝appilinx FPGA板上基于FPGA的验证。

      准备好安装吗?

      高密度脂蛋白校验™自动验证Xilinx上的HDL代码®通过启用FPGA in-the-loop (FIL)测试来实现FPGA板。FIL测试有助于确保MATLAB®算法或金宝app®设计行为与现实世界中的预期一致，增加了对硅实现的信心。利用MATLAB算法或Simulink模型驱动F金宝appPGA的输入刺激并分析FPGA的输出。通过使用FIL测试，您可以以FPGA速度验证设计，使您能够运行更广泛的测试用例集，并对设计执行回归测试。

      HDL验证器支持FIL仿真金宝app选择Xilinx FPGA板．这些板的板定义文件包括在支持包中。金宝app您可以添加其他FPGA板与FIL一起使用FPGA板定制．

      支持以下设备族:金宝app

      • Zynq®UltraScale +™MPSoC
      • Virtex®UltraScale, Kintex®UltraScale
      • Virtex-7、Kintex-7 Artix®7, zynq - 7000
      • Virtex-6,斯巴达®－6
      • Virtex-5
      • Virtex-4

      平台和发布支持金宝app

      看到硬件支持包系统要求金宝app表当前和以前的版本、发布版本和平台可用性。

      视图增强和bug修复发布说明．

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      下面列出的商用Xilinx FPGA板金宝app支持的FPGA器件的FIL模拟，或其他带有Xilinx FPGA的FPGA板金宝app支持FPGA器件族单板定制．

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