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将两个ip连接到视频流接口
SoC块集/硬件逻辑连接
的流连接器block连接两个具有视频流接口的ip。在SoC应用程序的FPGA模型中使用此块连接两个ip。
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wrData
从数据源输入视频数据。将此值指定为标量。
数据类型:单|双|int8|int16|int32|int64|uint8|uint16|uint32|uint64|不动点
单
双
int8
int16
int32
int64
uint8
uint16
uint32
uint64
不动点
wrCtrlIn
pixelControl
像素流伴随的控制信号,指定为pixelcontrol总线包含五个信号。信号描述像素的有效性和它在帧中的位置。的附加信息pixelcontrol总线类型,请参见AXI4-Stream视频接口.
pixelcontrol
数据类型:pixelcontrol
rdCtrlIn
控制信号,指示该块是否可以将视频数据发送到下游接口。当这个值为true时,下游块已经准备好接收数据。
rdData
将视频数据输出到下游目的IP。
rdCtrlOut
输出视频数据的控制信号,指定为pixelcontrol总线包含五个信号。信号描述像素的有效性和它在帧中的位置。
wrCtrlOut
表示块可以从上游接口接收流数据的控制信号。
数据类型:布尔
布尔
视频处理应用程序通常存储一帧完整的视频数据,用于处理这一帧并修改下一帧。在这种设计中,视频帧存储在外部存储器中,而FPGA资源用于处理相同的数据。这个例子展示了如何设计一个视频应用程序,使用HDMI输入和输出执行直方图均衡化,使用外部内存进行视频帧缓冲。
若要为您的设计自动生成HDL代码并在SoC设备上执行,请使用SoC建设者工具。看到生成SoC设计.
流连接器
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