HDL代码生成金宝app

从Simulink生成HDL代码金宝app®模型

通过生成HDL代码并将该代码部金宝app署到特定应用集成电路(ASIC)或现场可编程门阵列(FPGA)上，在硬件中实现Simulink模型或子系统。用与HDL代码生成兼容的块设计模型。如果模型使用浮点数据，则使用Fixed-Point Designer™将其转换为固定点模型。在生成HDL代码并验证它与原始算法匹配之后，将HDL代码部署到目标硬件上。

HDL代码生成金宝app基础知识
  • 模型与建筑设计
    金宝app支持块、最佳实践、设计模式、兼容性检查、时钟和重置
  • 代码生成
    HDL代码生成，代码配置，测试台生成
  • 验证
    生成的HDL代码与原始模型和fpga在环仿真验证
  • 部署
    合成脚本并将生成的HDL代码部署到Intel®, Xilinx®、极速山羊和定制FPGA板
  • 速度和面积优化
    通过资源共享、流、流水线、RAM映射、循环优化进行改进
  • 报告和脚本
    可追溯性、优化和资源报告;符合标准，合成脚本
HDL编码文档
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