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HDL Coder™可以生成一个IP核,将其集成到您的EDK项目中,并对Zynq硬件进行编程。使用嵌入式编码器®,可以生成和构建嵌入式软件,并在ARM上运行®处理器。
默认系统参考设计
了解默认系统参考设计和使用参考设计。
带有AXI4-Stream接口参考设计的默认系统
了解如何使用带有AXI4-Stream接口参考设计及其需求的默认系统。
默认视频系统参考设计
了解默认视频系统参考设计及其要求。
默认系统与外部DDR内存访问参考设计
了解默认系统与外部DDR3内存访问的参考设计及其需求。
Xilinx Zynq平台
模拟音频系统,并使用音频参考设计在Zynq®板上实现。
使用HDL Coder™和Embedded Coder®功能调试Zynq设计。
使用HDL验证器的FPGA数据捕获功能调试HDL编码器生成的IP核。
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