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HDL编码器™可以生成可以部署到Xilinx的自定义HDL IP核心®FPGA板。您可以将生成的IP核心集成到默认的系统参考设计或您自己的自定义参考设计中,以便注册电路板。
自定义IP核心生成
使用HDL Workflow Advisor,您可以从模型或算法生成自定义IP内核。
自定义IP核心报告
生成自定义IP核心时,默认情况下,您会生成HTML自定义IP核心报告。
IP缓存更快的参考设计合成
使用IP缓存来加速通过上下文的工作流程来加速参考设计合成时间。
在Simulink®模型中保存目标硬件设置。金宝app
您单击了与此MATLAB命令对应的链接:
在MATLAB命令窗口中输入它来运行命令。Web浏览器不支持MATLAB命令。金宝app
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