微半fpga和soc

在Microsemi设备上建模、验证和编写算法。

领域专家和硬件工程师使用MATLAB®和仿真软金宝app件®开发用于部署在Microsemi上的原型和生产应用程序®FPGA和SoC器件。使用MATLAB和Simulin金宝appk，您可以:

  • 在系统级对硬件架构进行建模
  • 在不写任何代码的情况下编写FPGA程序
  • 使用MATLAB和Simulink工具模拟和调试FPGA金宝app
  • 完成生产FPGA和SoC的设计

“作为一名机电系统工程师，我的专长是控制系统及其模型，而不是HDL和fpga。通过基于模型的设计，我可以利用我对控制器和被控制系统的理解和知识，完成更多通常由FPGA工程师完成的工作，并减少他们的工作量。”

Rob Reilink DEMCON

FPGA编程的建模

使用MATLAB和Simulink为算法添加硬件架构。金宝app这包括定点量化(30:45)，这样你就可以更有效地利用资源本机浮点(55)代码生成，使您可以更轻松fpga程序．重用您的测试和黄金参考算法来模拟每个连续的细化。

HDL Coder™直接从面向HDL的Simulink和MATLAB函数块生成可合成的VHDL或Verilog金宝app信号处理，无线通信，电机与功率控制,图像/视频处理．

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Microsemi fpga和soc编程

HDL Coder指导您通过步骤直接从Simulink编程FPGA或SoC，而无需编写任何一行代码。金宝app从HDL Coder，您可以优化和生成可合成的VHDL或Verilog以及axis接口，以插入SoC。从那里你可以调用嵌入式编码器®生成C/ c++来编写在嵌入式处理器上运行的软件。

使用HDL Coder，您可以指定Microsemi FPGA作为目标设备。您可以自动创建Libero®SoC设计套件项目，执行综合，并运行地点和路线。

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FPGA仿真与调试

HDL Verifier™可重用MATLAB和Simulink测试环境来验金宝app证FPGA设计。

与cosimulation(35分)，您可以自动运行MATLAB或Simulink测试台，连接到Verilog或VHDL设金宝app计，并在Mentor Graphics或Cadence design Systems的模拟器中运行。

FPGA-in-the-loop模拟将MATLAB或Simulink测试台连接到所支金宝app持的金宝appMicrosemi FPGA板通过以太网。

在MATLAB或Simulink测试台上测试你的设计实现。金宝app

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生产FPGA和SoC设计

领域专家和硬件工程师使用MATLAB和Simulink协作生产FPGA和SoC的设计金宝app无线，图像/视频处理(20:59)，电机与功率控制(24:20),安全至上应用程序。

HDL编码器的高级合成优化(49:42)帮助您实现设计目标，同时保持生成的RTL、模型和需求之间的可跟踪性，这对于高完整性工作流非常重要，例如做- 254．连同可合成的VHDL和Verilog, HDL编码器生成IP核方便地插入Libero进行系统集成。并生成HDL验证器验证模型(19)帮助速度试验台发展。

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